如今，電子設備的靈敏度越來(lái)越高，這要求設備的抗干擾能力也越來(lái)越強。因此，在PCB設計中，如何提高PCB的抗干擾能力成為眾多工程師們關(guān)注的重點(diǎn)問(wèn)題。下面是PCB工程師總結出來(lái)的，在PCB設計中降低噪聲與電磁干擾的方法：

1、能用低速芯片，就不要用高速芯片。

2、可用串一個(gè)電阻的辦法，降低控制電路速率。

3、使用滿(mǎn)足系統要求的最低頻率時(shí)鐘。

4、 時(shí)鐘產(chǎn)生器盡量近到用該時(shí)鐘的器件。

5、用地線(xiàn)將時(shí)鐘區圈起來(lái)，時(shí)鐘線(xiàn)盡量短。

6、印制電路板盡量使用45度折線(xiàn)，而不用90 折線(xiàn)，以減小高頻信號對外的發(fā)射與耦合。

7、印制板按頻率和電流開(kāi)關(guān)特性分區，噪聲元件與非噪聲元件要隔遠一些。

8、時(shí)鐘、總線(xiàn)、片選信號要遠離I/O 線(xiàn)和接插件。

9、模擬電壓輸入線(xiàn)、參考電壓端要盡量遠離數字電路信號線(xiàn)。

10、元件引腳盡量短，去耦電容引腳盡量短。

11、關(guān)鍵的線(xiàn)要盡量粗，并在兩邊加上保護地。高速線(xiàn)要短要直。

12、對噪聲敏感的線(xiàn)不要與大電流、高速開(kāi)關(guān)線(xiàn)平行。

13、石英晶體下面以及對噪聲敏感的器件下面不要走線(xiàn)。

14、弱信號電路，低頻電路周?chē)灰纬呻娏鳝h(huán)路。

15、信號都不要形成環(huán)路，如不可避免，讓環(huán)路區盡量小。

以上便是PCB工程師總結出來(lái)的，在PCB設計中降低噪聲與電磁干擾的一些方法，你都掌握了嗎？